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X Symposium on Integrated Circuits and Systems Design - 1997 - Gramado, RS, Brasil
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A WWW approach for EDA tool integration. 
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Functional design of GAROTA: gate array router for the agata system. 
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Synthesis of Profibus protocol using graph_fsm. 
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An accurate CMOS inverter model using spline interpolation and variable input capacitance. 
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Discrete models to logical devices simulation with the signal language. 
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Mônico Linares Aranda
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High speed CMOS ASIC's for digital signal processing. 
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Modeling and design of digital complex CMOS gates using neuro-fuzzy logic systems. 
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Martin Schubert
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Mixed-signal modeling in VHDL by distributed local iteration. 
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Josi Monteiro da Mata
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Implementation of a PWM interface using various techniques and tools. 
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System design methodology with dedicated controllers and compilers. 
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M. Strum
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J. C. Wang
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M. Y Teruya
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A. A. Jerraya
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A strategy for recursive high level synthesis. 
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Transformations for functional modules in hierarchical high level synthesis. 
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Alexandro Magno dos Santos Adário
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Mario Lúcio Cortes
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Neucimar Jerônimo Leite
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A FPGA implementation of a neighbourhood processor for digital image applications. 
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Carlos Augusto Paiva da Silva Martins
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João Antônio Zuffo
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Sérgio Takeo Kofuji
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Image reconstruction circuit using a new reconstruction technique. 
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Alvaro Russo Jr.
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Marius Strum
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José Roberto Amazonas
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A system level model of an ATM switch using Ptolemy. 
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An analytical area, access and cycle time model for on-chip multiported memories. 
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NCESPARC+: a cost-effective implementation of a multithreaded SPARC architecture. 
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A symbolic-based integrated tool for analog testing. 
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Data Path Functional Units BIST Plan Optimization: A Study-Case. 
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Use of an adaptative genetic algorithm in automatic test pattern generation of combinational circuits. 
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Self-exercising K-order comparators based on built-in current sensing. 
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A p-n junction-based precision temperature transducer integrated circuit. 
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A compact MOSFET model for circuit simulation. 
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A design methodology for MOS amplifiers. 
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The design methodology of a sample and hold for a low-power sensor interface circuit. 
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Using Petri nets to compute communication cost for hardware/software codesign. 
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A synchronous transition system and its application to the formal verification of VHDL designs. 
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Reducing coding style effects in high-level specifications. 
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A multi-phase asynchronous timing scheme. 
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Minimization of synchronous processes preserving bisimulation. 
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